XR16M890
UART WITH 128-BYTE FIFO AND INTEGRATED LEVEL SHIFTERS
F IGURE 26. R ECEIVE R EADY & I NTERRUPT T IMING [N ON -FIFO M ODE ]
REV. 1.0.0
RX
Start
Bit
D0:D7
Stop
Bit
D0:D7
D0:D7
T SSR
1 Byte
T SSR
1 Byte
T SSR
1 Byte
INT
RXRDY#
in RHR
T SSR
Active
Data
Ready
T RR
in RHR
T SSR
Active
Data
Ready
T RR
in RHR
T SSR
Active
Data
Ready
T RR
IOR#
(Reading data
out of RHR)
RXNFM
F IGURE 27. T RANSMIT R EADY & I NTERRUPT T IMING [N ON -FIFO M ODE ]
TX
(Unloading)
T WTS
IER[1] enabled
Start
Bit
D0:D7
ISR is read
Stop
Bit
D0:D7
ISR is read
D0:D7
ISR is read
INT*
T WRI
TXRDY#
IOW#
(Loading data
into THR)
T WT
T SRT
T WRI
T WT
T SRT
T WRI
T WT
T SRT
*INT is cleared when the ISR is read or when data is loaded into the THR.
58
TXNonFIFO
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